Autor der Publikation

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

A reconfigurable sense amplifier with 3X offset reduction in 28nm FDSOI CMOS., , , , und . VLSIC, Seite 270-. IEEE, (2015)A 467nW CMOS visual motion sensor with temporal averaging and pixel aggregation., , , , , , und . ISSCC, Seite 480-481. IEEE, (2013)A Charge-Injection-Based Active-Decoupling Technique for Inductive-Supply-Noise Suppression., und . ISSCC, Seite 416-417. IEEE, (2008)Automatic Generation of Behavioral Models from Switch-Level Descriptions., , , , und . DAC, Seite 179-184. ACM Press, (1989)In situ delay-slack monitor for high-performance processors using an all-digital self-calibrating 5ps resolution time-to-digital converter., , , , , , und . ISSCC, Seite 188-189. IEEE, (2010)DVS for On-Chip Bus Designs Based on Timing Error Correction, , , , und . CoRR, (2007)Circuit optimization techniques to mitigate the effects of soft errors in combinational logic., , , und . ACM Trans. Design Autom. Electr. Syst., 15 (1): 5:1-5:27 (2009)Energy Efficient Adiabatic FRAM with 0.99 PJ/Bit Write for IoT Applications., , , , , , und . VLSI Circuits, Seite 85-86. IEEE, (2018)A library compatible driving point model for on-chip RLC interconnects., , und . Timing Issues in the Specification and Synthesis of Digital Systems, Seite 63-69. ACM, (2002)Active shielding of RLC global interconnects., , und . Timing Issues in the Specification and Synthesis of Digital Systems, Seite 98-104. ACM, (2002)