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Disambiguierung von "Chen, Hsiang-Yu"

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A 1-ps Bin Size 4.87-ps Resolution FPGA Time-to-Digital Converter Based on Phase Wrapping Sorting and Selection.

, , , , , , und . IEEE Access, (2022)

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Chen-Hsiang Yu

Yu-Hsiang Yeh

Yu Chen

Yu Chen

Yu Chen

 

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