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Hardware DWT accelerator for MultiProcessor System-on-Chip on FPGA., , , , , , und . ICSAMOS, Seite 107-114. IEEE, (2006)Towards a performance-as-a-service cloud., , , , , und . SoCC, Seite 26:1-26:2. ACM, (2013)Partial Dynamic Reconfiguration: The Caronte Approach. A New Degree of Freedom in the HW/SW Codesign., und . FPL, Seite 1-2. IEEE, (2006)A hardware approach to protein identification., , , und . BioCAS, Seite 1-4. IEEE, (2015)A Case Study for an Accelerated DCNN on FPGA-Based Embedded Distributed System., , , , und . IPDPS Workshops, Seite 91-94. IEEE, (2019)On self-adaptive resource allocation through reinforcement learning., , , , , , , und . AHS, Seite 23-30. IEEE, (2013)Reconfigurable NoC design flow for multiple applications run-time mapping on FPGA devices., , , , , und . ACM Great Lakes Symposium on VLSI, Seite 421-424. ACM, (2009)A Reconfigurable Network-on-Chip Architecture for Optimal Multi-Processor SoC Communication., , , , und . VLSI-SoC (Selected Papers), Volume 313 von IFIP Advances in Information and Communication Technology, Seite 232-250. Springer, (2008)FPGA-Based Embedded System Implementation of Audio Signal Alignment., , , und . IPDPS Workshops, Seite 132-139. IEEE, (2019)On the automatic integration of hardware accelerators into FPGA-based embedded systems., , , , , und . FPL, Seite 607-610. IEEE, (2012)