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An efficient method for multi-level approximate logic synthesis under error rate constraint., und . DAC, Seite 128:1-128:6. ACM, (2016)Efficient batch statistical error estimation for iterative multi-level approximate logic synthesis., , und . DAC, Seite 54:1-54:6. ACM, (2018)A Graphical Model of Smoking-Induced Global Instability in Lung Cancer., , und . IEEE ACM Trans. Comput. Biol. Bioinform., 15 (1): 1-14 (2018)A Reconfigurable Multiplier for Signed Multiplications with Asymmetric Bit-Widths., , , , , , , und . ACM J. Emerg. Technol. Comput. Syst., 17 (4): 48:1-48:16 (2021)ALSRAC: Approximate Logic Synthesis by Resubstitution with Approximate Care Set., , und . DAC, Seite 1-6. IEEE, (2020)On microarchitectural modeling for CNFET-based circuits., , , , und . SoCC, Seite 356-361. IEEE, (2015)ALIFRouter: A Practical Architecture-Level Inter-FPGA Router for Logic Verification., , , , , und . DATE, Seite 1570-1573. IEEE, (2021)Accuracy Analysis for Stochastic Circuits with D Flip-Flop Insertion., und . DATE, Seite 598-603. IEEE, (2020)VACSEM: Verifying Average Errors in Approximate Circuits Using Simulation-Enhanced Model Counting., , , , und . DATE, Seite 1-6. IEEE, (2024)The synthesis of robust polynomial arithmetic with stochastic logic., und . DAC, Seite 648-653. ACM, (2008)