Autor der Publikation

A Reference-less Sense Amplifier to Sense pA Currents in Ferroelectric Tunnel Junction Memories.

, , und . MOCAST, Seite 1-4. IEEE, (2023)

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

Minimal Buffer Insertion Based Low Power Clock Tree Synthesis for 3D Integrated Circuits., und . Journal of Circuits, Systems, and Computers, 25 (11): 1650142:1-1650142:17 (2016)Hyper Dimensional Computing with Ferroelectric Tunneling Junctions., , , , , und . NANOARCH, Seite 3:1-3:2. ACM, (2023)Memristive logic: A framework for evaluation and comparison., , , , , , und . PATMOS, Seite 1-8. IEEE, (2017)A Taxonomy and Evaluation Framework for Memristive Logic., , , , , , und . Handbook of Memristor Networks, Springer, (2019)Comparative study of usefulness of FeFET, FTJ and ReRAM technology for ternary arithmetic., , und . ICECS, Seite 1-6. IEEE, (2021)Direct state transfer in MLC based memristive ReRAM devices for ternary computing., und . ECCTD, Seite 1-5. IEEE, (2020)Carry-free Addition in Resistive RAM Array: n-bit Addition in 22 Memory Cycles., und . ISVLSI, Seite 157-163. IEEE, (2021)A Time-based Sensing Scheme for Multi-level Cell (MLC) Resistive RAM., und . NORCAS, Seite 1-6. IEEE, (2019)A Reference-less Sense Amplifier to Sense pA Currents in Ferroelectric Tunnel Junction Memories., , und . MOCAST, Seite 1-4. IEEE, (2023)A Novel In-Memory Wallace Tree Multiplier Architecture Using Majority Logic., , und . IEEE Trans. Circuits Syst. I Regul. Pap., 69 (3): 1148-1158 (2022)