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A Predictive Process Design Kit for Three-Independent-Gate Field-Effect Transistors., , , und . VLSI-SoC (Selected Papers), Volume 586 von IFIP Advances in Information and Communication Technology, Seite 307-322. Springer, (2019)Low Latency SEU Detection in FPGA CRAM With In-Memory ECC Checking., , , , , und . IEEE Trans. Circuits Syst. I Regul. Pap., 70 (5): 2028-2036 (Mai 2023)GMS: Generic memristive structure for non-volatile FPGAs., , , , und . VLSI-SoC, Seite 94-98. IEEE, (2012)3D Nanofabric: Layout Challenges and Solutions for Ultra-scaled Logic Designs., , , , und . VLSI-SoC (Selected Papers), Volume 621 von IFIP Advances in Information and Communication Technology, Seite 279-300. Springer, (2020)Improving LUT-based optimization for ASICs., , , , , , und . DAC, Seite 421-426. ACM, (2022)Towards More Efficient Logic Blocks By Exploiting Biconditional Expansion (Abstract Only)., , , , und . FPGA, Seite 262. ACM, (2015)GenCache: Leveraging In-Cache Operators for Efficient Sequence Alignment., , , , , , und . MICRO, Seite 334-346. ACM, (2019)Differential Power Analysis Mitigation Technique Using Three-Independent-Gate Field Effect Transistors., und . VLSI-SoC, Seite 107-112. IEEE, (2018)A high-performance low-power near-Vt RRAM-based FPGA., , und . FPT, Seite 207-214. IEEE, (2014)Multiple Independent Gate FETs: How many gates do we need?, , , , und . ASP-DAC, Seite 243-248. IEEE, (2015)