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Disambiguierung von "Varadarajan, Keshavan"

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Design space exploration of systolic realization of QR factorization on a runtime reconfigurable platform.

, , , , und . ICSAMOS, Seite 265-272. IEEE, (2010)

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Balamurugan Varadarajan

Varadarajan Seshadri

Badri Varadarajan

Sriram Varadarajan

 

Weitere Publikationen von Autoren mit dem selben Namen

Dataflow Graph Partitioning for Optimal Spatio-Temporal Computation on a Coarse Grain Reconfigurable Architecture., , , , , und . ARC, Volume 6578 von Lecture Notes in Computer Science, Seite 125-132. Springer, (2011)Interconnect-topology independent mapping algorithm for a Coarse Grained Reconfigurable Architecture., , , und . FPT, Seite 1-5. IEEE, (2011)RECONNECT: A NoC for polymorphic ASICs using a low overhead single cycle router., , , , , , und . ASAP, Seite 251-256. IEEE Computer Society, (2008)Enhancements for variable N-point streaming FFT/IFFT on REDEFINE, a runtime reconfigurable architecture., , , , , , und . ICSAMOS, Seite 178-184. IEEE, (2010)Design space exploration of systolic realization of QR factorization on a runtime reconfigurable platform., , , , und . ICSAMOS, Seite 265-272. IEEE, (2010)Accelerating multi-core simulators., , , und . SAC, Seite 2377-2382. ACM, (2010)Streaming FFT on REDEFINE-v2: an application-architecture design space exploration., , , , , , , und . CASES, Seite 127-136. ACM, (2009)Towards minimizing execution delays on dynamically reconfigurable processors: a case study on REDEFINE., , , , , , und . CASES, Seite 77-86. ACM, (2010)Synthesis of application accelerators on Runtime Reconfigurable Hardware., , , , , , , und . ASAP, Seite 13-18. IEEE Computer Society, (2008)Molecular Caches: A caching structure for dynamic creation of application-specific Heterogeneous cache regions., , , , , , und . MICRO, Seite 433-442. IEEE Computer Society, (2006)