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1Implementation of 8x8 Vedic Multiplier using Verilog
M. Shajahan. INTERNATIONAL JOURNAL OF TREND IN SCIENTIFIC RESEARCH AND DEVELOPMENT, 8 (2): 808-815 (April 2024)
vor 3 Monaten von @ijtsrd
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FPGA,
RSIC
URDHVATIRYAKBHYAM,
FPGA,RSICURDHVATIRYAKBHYAM,
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1JPEG XS, a new standard for visually lossless low-latency lightweight image compression
A. Descampe, J. Keinert, T. Richter, S. Fößel, und G. Rouvroy. Applications of Digital Image Processing XL, 10396, Seite 68 -- 79. International Society for Optics and Photonics, SPIE, (2017)
vor 5 Jahren von @trougnouf
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CPU
Committee,
FPGA,
GPU,
IP
JPEG
Standard,
broadcast,
compression,
image
transport,
CPUCommittee,FPGA,GPU,IPJPEGStandard,broadcast,compression,imagetransport,
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1HARDWARE SOFTWARE CO-SIMULATION FOR TRAFFIC LOAD COMPUTATION USING MATLAB SIMULINK MODEL BLOCKSET
A. GUPTA. International Journal of Computational Science and Information Technology (IJCSITY), 1 (2): 1 - 12 (Mai 2013)
vor 5 Jahren von @anderson_sam
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Detection.
Edge
FPGA,
Generator,
Image
System
Vehicle
Xilinx
detection,
processing,
Detection.EdgeFPGA,Generator,ImageSystemVehicleXilinxdetection,processing,
(0)
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1FPGA Based Cipher Design & Implementation of Recursive Oriented Block Arithmetic and Substitution Technique (ROBAST)
P. Rajdeep Chakraborty JK Mandal. International Journal of Advanced Computer Science and Applications(IJACSA), (2011)
vor 11 Jahren von @thesaiorg
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Block
Cipher,
Cryptography,
FPGA,
Key,
Private
RTL,
Session
Symmetric/Private
and
cryptosystem.,VHDL
key
BlockCipher,Cryptography,FPGA,Key,PrivateRTL,SessionSymmetric/Privateandcryptosystem.,VHDLkey
(0)
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1FPGA Based Cipher Design & Implementation of Recursive Oriented Block Arithmetic and Substitution Technique ( ROBAST )
R. Chakraborty. IJACSA - International Journal of Advanced Computer Science and Applications, 2 (4): 54--59 (2011)
vor 14 Jahren von @editorijacsa
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"VHDL,
Block
Cipher,
FPGA,
Pr,block
RTL,
Session
and
and,symmetric,vhdl
cipher,cryptography,dept,engineering,fpga,jk
computer
cryptosystem,professor,rtl,session
key
key,private
mandal,of
science,private
"VHDL,BlockCipher,FPGA,Pr,blockRTL,Sessionandand,symmetric,vhdlcipher,cryptography,dept,engineering,fpga,jkcomputercryptosystem,professor,rtl,sessionkeykey,privatemandal,ofscience,private
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1Trade-off between pure software based and FPGA based base band processing for a real time kinematics GNSS receiver
T. Lueck, M. Bodenbach, J. Winkel, T. Pany, D. Sanroma, B. Eisfeller, und F. Forster. Proc. of the 18th ION GNSS Conf., (2005)
vor 14 Jahren von @bmuth
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FPGA,
GPS,
RTK,
acquisition,
softwareReceiver
FPGA,GPS,RTK,acquisition,softwareReceiver
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1Software Radio and its Applications in GNSS
P. Kovar, und F. Vejrazka. Proc. of the 46th International Symposium on Electronics in Marine (ELMAR), (2004)
vor 14 Jahren von @bmuth
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DSP,
FPGA,
GPS,
Galileo,
softwareReceiver
DSP,FPGA,GPS,Galileo,softwareReceiver
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2Real-time computation of Zernike moments
L. Kotoulas, und I. Andreadis. IEEE Transactions on Circuits and Systems for Video Technology, 15 (6): 801--809 (2005)
vor 14 Jahren von @cocus
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FPGA,
Zernike
arrays,
complexity,
computation
computational
descriptor,
field
gate
geometric
image
method
moment,
moments
of
polynomials,
processing,
programmable
real-time
retrieval,
FPGA,Zernikearrays,complexity,computationcomputationaldescriptor,fieldgategeometricimagemethodmoment,momentsofpolynomials,processing,programmablereal-timeretrieval,
(0)
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2Real-time computation of Zernike moments
L. Kotoulas, und I. Andreadis. 15 (6): 801--809 (2005)
vor 14 Jahren von @cocus
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FPGA,
Zernike
arrays,
complexity,
computation
computational
descriptor,
field
gate
geometric
image
method
moment,
moments
of
polynomials,
processing,
programmable
real-time
retrieval,
FPGA,Zernikearrays,complexity,computationcomputationaldescriptor,fieldgategeometricimagemethodmoment,momentsofpolynomials,processing,programmablereal-timeretrieval,
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3In-system FPGA prototyping of an itanium microarchitecture
R. Wunderlich, und J. Hoe. FPGA '04: Proceedings of the 2004 ACM/SIGDA 12th international symposium on Field programmable gate arrays, Seite 255. New York, NY, USA, ACM, (2004)
vor 16 Jahren von @earthfare
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fpga,
p86\_paper,
x86
fpga,p86\_paper,x86
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1A Fully Integrated PC-architecture SoC for Industrial Control
W. Jing, F. Xiaoya, Z. Shenbing, Z. Meng, und W. Hai. Integrated Circuits, 2007. ISIC '07. International Symposium on, Seite 516--519. (2007)
vor 16 Jahren von @earthfare
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fpga,
p86\_paper,
x86
fpga,p86\_paper,x86
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2Automated hardware design using genetic programming, VHDL, and FPGAs
R. Popp, D. Montana, R. Gassner, G. Vidaver, und S. Iyer. IEEE International Conference on Systems, Man, and Cybernetics, 3, Seite 2184--2189. San Diego, CA USA, IEEE, (11-14 October 1998)
vor 17 Jahren von @brazovayeye
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CAD,
Description
FPGA,
Hardware
Language,
VHDL,
VHSIC
algorithms,
arrays,
automated
circuit
configuration
description
design
design,
evolution,
field
gate
genetic
hardware
languages,
logic,
management,
optimisation,
programmable
programming,
requirements,
software
system
variants
CAD,DescriptionFPGA,HardwareLanguage,VHDL,VHSICalgorithms,arrays,automatedcircuitconfigurationdescriptiondesigndesign,evolution,fieldgategenetichardwarelanguages,logic,management,optimisation,programmableprogramming,requirements,softwaresystemvariants
(0)
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2Evolvable Reasoning Hardware: Its Prototyping and Performance Evaluation
M. Yasunaga, J. Kim, und I. Yoshihara. Genetic Programming and Evolvable Machines, 2 (3): 211--230 (September 2001)
vor 17 Jahren von @brazovayeye
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FPGA,
MBRTalk
NETTalk,
VLSI
algorithms,
design
evolvable
genetic
hardware,
methodology,
reasoning,
FPGA,MBRTalkNETTalk,VLSIalgorithms,designevolvablegenetichardware,methodology,reasoning,
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2A Hardware Implementation of a Genetic Programming System Using FPGAs and Handel-C
P. Martin. Genetic Programming and Evolvable Machines, 2 (4): 317--343 (Dezember 2001)
vor 17 Jahren von @brazovayeye
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FPGA,
Handel-C,
algorithm
algorithms,
evolvable
genetic
hardware,
parallel
programming,
FPGA,Handel-C,algorithmalgorithms,evolvablegenetichardware,parallelprogramming,
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1Book Review: Bio-Inspired Computing Machines: Towards Novel Computational Architectures
G. Greenwood. Genetic Programming and Evolvable Machines, 2 (1): 75--78 (März 2001)
vor 17 Jahren von @brazovayeye
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FPGA,
L-Systems
algorithms,
evolution
evolutionary
evolvable
genetic
hardware,
programming,
strategies,
FPGA,L-Systemsalgorithms,evolutionevolutionaryevolvablegenetichardware,programming,strategies,
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1Parallel Genetic Programming
F. Fernandez, G. Spezzano, M. Tomassini, und L. Vanneschi. Parallel Metaheuristics, Kapitel 6, Wiley-Interscience, Hoboken, New Jersey, USA, (2005)
vor 17 Jahren von @brazovayeye
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CGPC,
EHW,
FPGA,
algorithms,
bagCGPC
cellular
classifiers,
ensemble
genetic
grid
island
model,
of
placement
programming,
structure,
CGPC,EHW,FPGA,algorithms,bagCGPCcellularclassifiers,ensemblegeneticgridislandmodel,ofplacementprogramming,structure,
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2Time series forecasting using massively parallel genetic programming
S. Eklund. Proceedings of Parallel and Distributed Processing International Symposium, Seite 143--147. (22-26 April 2003)
vor 17 Jahren von @brazovayeye
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EHW,
FPGA,
Virtex
XC2V10000,
algorithms,
genetic
programming,
sunspot
wolfe
EHW,FPGA,VirtexXC2V10000,algorithms,geneticprogramming,sunspotwolfe
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2Applying Genetic Parallel Programming to Synthesize Combinational Logic Circuits
S. Cheang, K. Lee, und K. Leung. IEEE Transactions on Evolutionary Computation, 11 (4): 503--520 (August 2007)
vor 17 Jahren von @brazovayeye
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Circuit
FPGA,
algorithms,
circuits,
design,
digital
evolvable
genetic
hardware,
parallel
programming
programming,
CircuitFPGA,algorithms,circuits,design,digitalevolvablegenetichardware,parallelprogrammingprogramming,
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