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GNNIE: GNN Inference Engine with Load-balancing and Graph-Specific Caching., , , und . CoRR, (2021)A general approach for identifying hierarchical symmetry constraints for analog circuit layout., , , , , und . ICCAD, Seite 120:1-120:8. IEEE, (2020)Learning from Experience: Applying ML to Analog Circuit Design., , , , , , , , , und 2 andere Autor(en). ISPD, Seite 55. ACM, (2020)GANA: Graph Convolutional Network Based Automated Netlist Annotation for Analog Circuits., , , , , , , , , und . DATE, Seite 55-60. IEEE, (2020)Understanding Distance-Dependent Variations for Analog Circuits in a FinFET Technology., , , , , , und . ESSDERC, Seite 69-72. IEEE, (2023)Fast and Efficient Constraint Evaluation of Analog Layout Using Machine Learning Models., , , , , , , , , und . ASP-DAC, Seite 158-163. ACM, (2021)Assessing Economic Viability: A Comparative Analysis of Total Cost of Ownership for Domain-Adapted Large Language Models versus State-of-the-art Counterparts in Chip Design Coding Assistance., , , , , und . CoRR, (2024)A Unified Engine for Accelerating GNN Weighting/Aggregation Operations, With Efficient Load Balancing and Graph-Specific Caching., , , , , und . IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., 42 (12): 4844-4857 (Dezember 2023)Machine Learning Techniques in Analog Layout Automation., , , , , , , , , und 3 andere Autor(en). ISPD, Seite 71-72. ACM, (2021)A Multicore GNN Training Accelerator., , , , und . ISLPED, Seite 1-6. IEEE, (2023)