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Disambiguierung von "Calimera, Andrea"

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Energy-Efficient Convolutional Neural Networks via Recurrent Data Reuse.

, , und . DATE, Seite 848-853. IEEE, (2019)

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Andrea Witzenrath

Risikofaktoren für abdominelle Komplikationen nach kardiopulmonalem Bypass. Uni Erlangen-Nürnberg, (2009)

Andrea Rottach

Analysis of the cell cycle dependent dynamics of Dnmt1 and Np95 in living cells. Uni München, (2009)

Andrea Hruby

Die MAPKKK Bck1p des Zellwand-Integritätssignalwegs in der Bäckerhefe Saccharomyces cerevisiae. Uni Münster, (2009)

Michaela Andrea Fingas

Resultate nach radikaler Prostatektomie bei Patienten mit einem Prostatakarzinom Gleason 7-10. Uni Marburg, (2009)

Andrea Meyer

 

Weitere Publikationen von Autoren mit dem selben Namen

Reducing leakage power by accounting for temperature inversion dependence in dual-Vt synthesized circuits., , , und . ISLPED, Seite 217-220. ACM, (2008)Design and Characterization of Analog-to-Digital Converters using Graphene P-N Junctions., , , , und . ACM Great Lakes Symposium on VLSI, Seite 253-258. ACM, (2015)Power modeling and characterization of Graphene-based logic gates., , , und . PATMOS, Seite 223-226. IEEE, (2013)Interactive presentation: Efficient computation of discharge current upper bounds for clustered sleep transistor sizing., , , , , und . DATE, Seite 1544-1549. EDA Consortium, San Jose, CA, USA, (2007)Design of a Flexible Reactivation Cell for Safe Power-Mode Transition in Power-Gated Circuits., , , , und . IEEE Trans. Circuits Syst. I Regul. Pap., 56-I (9): 1979-1993 (2009)Dataflow Restructuring for Active Memory Reduction in Deep Neural Networks., und . DATE, Seite 114-119. IEEE, (2021)Sub-Row Sleep Transistor Insertion for Concurrent Clock-Gating and Power-Gating., , , , und . PATMOS, Volume 6951 von Lecture Notes in Computer Science, Seite 214-225. Springer, (2011)Integer ConvNets on Embedded CPUs: Tools and Performance Assessment on the Cortex-A Cores., , , und . ICECS, Seite 598-601. IEEE, (2019)EAST: Encoding-Aware Sparse Training for Deep Memory Compression of ConvNets., , und . AICAS, Seite 233-237. IEEE, (2020)Adaptive Test-Time Augmentation for Low-Power CPU., , , , und . CoRR, (2021)