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Disambiguierung von "Vemuri, Ranga"

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Reduced Complementary Dynamic and Differential Logic: A CMOS Logic Style for DPA-Resistant Secure IC Design.

, , und . VLSI Design, Seite 699-705. IEEE Computer Society, (2008)

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Janki Rangatia

Sripriya Rangarajan

Kiril Rangatscheff

Hiranmayi Ranganathan

Palani Murugan Rangasamy

 

Weitere Publikationen von Autoren mit dem selben Namen

Battery-efficient task execution on portable reconfigurable computing., , und . SoCC, Seite 237-240. IEEE, (2004)A Decomposition-based Symbolic Analysis Method for Analog Synthesis from Behavioral Specifications., und . VLSI, Volume 162 von IFIP Conference Proceedings, Seite 305-317. Kluwer, (1999)Adaptive Sampling and Modeling of Analog Circuit Performance Parameters., , und . VLSI-SOC, Seite 142-. Technische Universität Darmstadt, Insitute of Microelectronic Systems, (2003)MSL: A High-Level Language for Parameterized Analog and Mixed Signal Layout Generators., und . VLSI-SOC, Seite 416-421. Technische Universität Darmstadt, Insitute of Microelectronic Systems, (2003)Throughput Optimization with Design Space Exploration During Partitioning for Multi-FPGA Architectures., und . FPGA, Seite 253. ACM, (1999)An efficient algorithm for finding empty space for online FPGA placement., und . DAC, Seite 960-965. ACM, (2004)Topology synthesis of analog circuits based on adaptively generated building blocks., und . DAC, Seite 44-49. ACM, (2008)Hybrid Shielding: Amplifying the Power of Camouflaging and Logic Encryption., und . MWSCAS, Seite 1103-1107. IEEE, (2023)RELUT-GNN: Reverse Engineering Data Path Elements From LUT Netlists Using Graph Neural Networks., , , , , und . MWSCAS, Seite 511-515. IEEE, (2023)Dynamic Characteristics of Power Gating During Mode Transition., , und . IEEE Trans. Very Large Scale Integr. Syst., 19 (2): 237-249 (2011)