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Rigel: an architecture and scalable programming interface for a 1000-core accelerator., , , , , , , , und . ISCA, Seite 140-151. ACM, (2009)Speculative reconvergence for improved SIMT efficiency., , , , , , und . CGO, Seite 121-132. ACM, (2020)Architecting an Energy-Efficient DRAM System for GPUs., , , , , , und . HPCA, Seite 73-84. IEEE Computer Society, (2017)A Task-Centric Memory Model for Scalable Accelerator Architectures., , , , und . PACT, Seite 77-87. IEEE Computer Society, (2009)A variable warp size architecture., , , und . ISCA, Seite 489-501. ACM, (2015)Cohesion: a hybrid memory model for accelerators., , , , und . ISCA, Seite 429-440. ACM, (2010)A patch memory system for image processing and computer vision., , , , und . MICRO, Seite 51:1-51:13. IEEE Computer Society, (2016)GoldMine: Automatic assertion generation using data mining and static analysis., , , , , und . DATE, Seite 626-629. IEEE Computer Society, (2010)Tradeoffs in designing accelerator architectures for visual computing., , , und . MICRO, Seite 164-175. IEEE Computer Society, (2008)GPU Subwarp Interleaving., , , , , und . HPCA, Seite 1184-1197. IEEE, (2022)