Autor der Publikation

A Self-Reconfiguring Cache Architecture to Improve Control Quality in Cyber-Physical Systems.

, , , , , und . ISORC, Seite 116-123. IEEE Computer Society, (2018)

Bitte wählen Sie eine Person um die Publikation zuzuordnen

Um zwischen Personen mit demselben Namen zu unterscheiden, wird der akademische Grad und der Titel einer wichtigen Publikation angezeigt. Zudem lassen sich über den Button neben dem Namen einige der Person bereits zugeordnete Publikationen anzeigen.

 

Weitere Publikationen von Autoren mit dem selben Namen

NvMISC: Toward an FPGA-Based Emulation Platform for RISC-V and Nonvolatile Memories., , , und . IEEE Embed. Syst. Lett., 15 (4): 170-173 (Dezember 2023)ReLAccS: A Multilevel Approach to Accelerator Design for Reinforcement Learning on FPGA-Based Systems., , , und . IEEE Trans. Comput. Aided Des. Integr. Circuits Syst., 40 (9): 1754-1767 (2021)Distributed resource management for concurrent execution of multimedia applications on MPSoC platforms., , , und . ICSAMOS, Seite 132-139. IEEE, (2011)Communication and migration energy aware design space exploration for multicore systems with intermittent faults., , und . DATE, Seite 1631-1636. EDA Consortium San Jose, CA, USA / ACM DL, (2013)A predictable communication assist., , , , , und . Conf. Computing Frontiers, Seite 97-98. ACM, (2010)PR-HMPSoC: A versatile partially reconfigurable heterogeneous Multiprocessor System-on-Chip for dynamic FPGA-based embedded systems., und . FPL, Seite 1-6. IEEE, (2014)Criticality-aware scrubbing mechanism for SRAM-based FPGAs., , , und . FPL, Seite 1-8. IEEE, (2014)Design and robust scheduling of nano-satellite swarm for synthetic aperture radar applications., , , und . ICARCV, Seite 705-710. IEEE, (2014)QoS-Aware Cross-Layer Reliability-Integrated FPGA-Based Dynamic Partially Reconfigurable System Partitioning., , , und . FPT, Seite 230-233. IEEE, (2018)ParaFRo: A hybrid parallel FPGA router using fine grained synchronization and partitioning., , und . FPL, Seite 1-11. IEEE, (2016)